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電磁流量計設計程序研究與探討 五十九
時間:2012/8/4 8:04:25  來源:本站原創  點擊:2042

電磁流量計設計程序研究與探討  五十九

電磁流量計鐵電存儲器的使能片選CS與單片機的P52端口相連,當為高電平時,所有的輸出均處于高阻態,同時芯片忽略其它的輸入,此時芯片保持在低功耗狀態。當片選為低電平時,芯片根據SCK的信號而動作,在任何操作之前,CS必須有一個下降沿;串行輸出SO與單片機的P51端口相連,SO是數據輸入管腳。它只在讀操作中有效,否則均保持高阻狀態,包括在HOLD管腳為低電平的時。數據在時鐘的下降沿移出Nso上;寫保護WP與端EP53相連,這個管腳的作用是阻止對狀態寄存器進行寫操作,因為其它的寫保護特性是通過狀態寄存器來控制的;VSS為電源地;串行輸入SI與端口P51相連,所有的傳輸數據都是通過這個管腳輸入芯片的。此引腳的信號在時鐘的上升沿被采樣,在其它時間被忽略。串行時鐘SCK與端VIP50相連,所有的輸入輸出都與時鐘信號同步,輸入在時鐘的上升沿被鎖存,而輸出則出現在時鐘的下降沿;HOLD與端口P54相連,當CPU中止當前內存操作時,HOLDrJl腳被使用。使HOLDiJI腳置為低電平,則暫停當前的操作。芯片忽略SCKCS上的所有的改變,只有當SCK信號為低電平時,HOLD狀態才會發生改變;VDD為鐵電存儲器的電源,接33V的電壓,而.這也是在芯片低功耗操作時的正常電壓。

電磁流量計

 

 

 
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